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FPGA/CPLD问答列表

ISE10.1除法器IP核问题,各位大侠帮帮忙,很着急》。。。。

ISE10.1除法器IP核问题,各位大侠帮帮忙,很着急》。。。。
我尝试了IP内核中的Math Functions--dividers, 里面有2个IP核,我都试过了,仿真的时候输出总是高阻状态。 我使用的是Xilinx V2PRO, ISE ...
2012年05月24日 16:01   |  
IP核   ISE   除法器  

拜求大神帮忙看看这段代码

拜求大神看看这段代码,我都快眼花了,就是看不明白到底是干什么的?请告诉我具体功能及架构(原理图)怎么测试功能?
2012年05月23日 23:17   |  
verilog  

跪求大神讲解代码!!!!

具体原理、架构不是很清楚,希望能有大神帮忙指点,最好给出大发快3架构图
2012年05月23日 14:27   |  
verilog  

FPGA 设计加法器的verilog程序

我是刚开始学FPGA,现在对其verilog语言还不是很懂。下面题目:设计一个十进制的加法计数器,功能包含复位信号,置位信号,每个时钟的正跳变 ...
2012年05月11日 22:59   |  
verilog   大发快3 加法器  

fpga做DDS信号源关于频率分辨率的问题

小弟初学FPGA,现在要做一个DDS信号源。根据DDS的原理,频率分辨率是fs的1/(2的N次方)。但是现在一般没有一个fs是一个2的N次方Hz的频率。 ...
2012年04月21日 22:59   |  
DDS   大发快3 FPGA   频率分辨率  

LDPC码IP核求购

有没有公司或个人已经对ccsds标准下的LDPC码的编码和译码研发出来了?最近工程应用时间比较紧,紧急求购,,,,
2012年04月17日 00:04   |  
LDPC码IP核  

新手报到,求PCIE的接大发快3口配置相关资料

学习FPGA,需要做PCIE的接口配置,请问谁懂这方面的或有这方面资大发快3料的,给支持一下,谢谢!
2012年04月16日 09:48

用FPGA图像处理并用VGA显示的问题!!!

毕设需要做一个用FPGA处理图像并且通过VGA显示在屏幕上的东西, 有很多不解的地方,之前我只是用ISE VHDL语言写过一些小程序,对这个要做的 ...
2012年04月08日 14:55   |  
FPGA   VGA   图像  

如何用FPGA+vhdl,实现M序列~~

M序列:f(x)=1+x^2+x^3+x^4+x^8.请大家尽量详细点啊(要是有说明更好啦)。。。谢谢啦
2012年04月04日 19:43   |  
FPG大发快3A   M序列   VHDL   如何  

FPGA基本动态可重构

我要做一个动态可重构,用两个FPGA实现两种算法的动态切换,也就是用一个FPGA控制另一个FPGA实现两种逻辑的切换,我现在只是把这两种的Veri ...
2012年03月31日 18:48   |  
可重构  

求教FPGA数字信号音频处理

最近做FPGA数字信号音频处理论文,感觉自己没有方向和素材,大致体系还没摸清,需要学那些东西才能完整作出则篇论文?哪位能给予帮助不甚感 ...
2012年03月07日 22:43   |  
FPGA数字信号音频处理  

真诚的问一下FPGA的前辈,我是FPGA的初学者,还没入门,需要买开发板吗?

我有数电模电基础,学过c语言,想学FPGA,初学者,还是小白,大概买那种芯片,或者那种开发板比较好,真诚求助
2012年03月06日 19:48

求助

谁有quartusii 9.1的破解文件,帮助一下,谢谢!
2012年02月17日 22:21

谁知道

Verilog HDl和vhdl相比谁的优势大一些
2012年02月15日 22:58

CPLD有一个管脚不工作

程序烧写成功后,CPLD的触发管脚一直处于高阻态,整个电路一上电就触发,想知道是CPLD的问题还是PCB 的问题。若是CPLD 的问题,那CPLD 是根 ...
2012年02月14日 08:56   |  
CPL大发快3D  

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